| ISBN | 出版时间 | 包装 | 开本 | 页数 | 字数 |
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译者序
前言
第1章 高速度结构设计
1.1 高流量
1.2 低时滞
1.3 时序
1.3.1 添加寄存器层次
1.3.2 并行结构
1.3.3 展平逻辑结构
1.3.4 寄存器平衡
1.3.5 重新安排路径
1.4 小结
第2章 面积结构设计
2.1 折叠流水线
2.2 基于控制的逻辑复用
2.3 资源共享
2.4 复位对面积的影响
2.4.1 无复位的资源
2.4.2 无置位的资源
2.4.3 无同步复位的资源
2.4.4 复位RAM
2.4.5 利用置位/复位触发器引脚
2.5 小结
第3章 功耗结构设计
3.1 时钟控制
3.1.1 时钟偏移
3.1.2 控制偏移
3.2 输入控制
3.3 减少供电电压
3.4 双沿触发触发器
3.5 修改终端
3.6 小结
第4章 设计实例:高级加密标准
4.1 AES结构
4.1.1 一级字节代换
4.1.2 零级行间移位
4.1.3 两个流水线级列混合
4.1.4 一级轮密钥加
4.1.5 紧缩结构
4.1.6 部分流水线结构
4.1.7 完全流水线结构
4.2 性能与面积
4.3 其他的优化
第5章 高级设计
5.1 抽象设计技术
5.2 图形状态机
5.3 DSP设计
5.4 软硬件协同设计
5.5 小结
第6章 时钟区域
6.1 跨越时钟区域
6.1.1 准稳态
6.1.2 解决方案一:相位控制
6.1.3 解决方案二:双跳技术
6.1.4 解决方案三:FIFO结构
6.1.5 分割同步模块
6.2 在ASIC样机中的门控时钟
6.2.1 时钟模块
6.2.2 选通移除
6.3 小结
第7章 设计实例:12S与SPDIF
7.1 I2S
7.1.1 协议
7.1.2 硬件结构
7.1.3 分析
7.2 SPDIF
7.2.1 协议
7.2.2 硬件结构
7.2.3 分析
第8章 实现数学函数
第9章 设计实例:浮点单元
第10章 复位电路
第11章 高级仿真
第12章 综合编码
第13章 设计实例:安全散列算法
第14章 综合优化
第15章 布图
第16章 布局布线优化
第17章 设计实例:微处理器
第18章 静态时序分析
第19章 PCB的问题
附录A AES密码的流水线级
附录B SRC处理器的顶层模块
参考文献